quartus模擬16:基於全加器和D觸發器的序列加法器
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課本上的一道例題,上課時沒聽懂,用quartus模擬一遍
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波形圖中真正有效的數字是較大號的數字,因為輸入X在時鐘下降沿處有個狀態翻轉
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quartus模擬波形正確
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第一幅波形圖變化在時鐘下降沿。第二幅圖輸入稍微推後到時鐘上升沿進行對比,波形一致,這裡很奇怪在一個時鐘週期內Q和輸入均為改變Z的值也發生了變化,未解之謎。
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從時序圖看出電路功能,輸入最低有效位在先,以序列的方式輸出和。進位端COUT輸出至D觸發器儲存,下一個時鐘週期再送到全加器的輸入端與較高位進行相加。第一幅輸入方式為X1=1010 1001 1010這表示最高有效位在先,然而資料是最高位先進入系統所以X1=101 10001 0101
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