jchdl - RTL實例 - MOS6502 ALU (Verilog)
https://mp.weixin.qq.com/s/jLUz757FQZjMEYzYb2AIww
MOS6502是簡單，但是曾經相當流行的一款CPU。網上有很多模擬程序可供學習使用。這裏使用一個較為精簡的Verilog項目，介紹MOS6502這款CPU的運行機制，然後使用jchdl進行模擬。 參考項目：https://github.com/Arlet/verilog-6502 該項目只包含兩個文件：alu.v, cpu.v。這裏首先介紹alu.v。 1. 註釋部分簡介了ALU的主要功能，根據op的不同，對AI/BI進行運算。 ?- A+B: temp_BI直接緩存BI的值，後續參與運算。
- A-B：減法運算需要對BI求2的補碼，即取反加一，這裏先行取反。
- A+A：temp_BI緩存temp_logic的值，此時temp_logic中存的是AI的值，所以是A+A。
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