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Verilog用$readmemh匯入資料

       reg [31:0]test[10:0];       initial $readmemh("G:/vivadoproject/test2/rtl/hello.txt",test);       //用絕對路徑保穩點         integer i = 0;         initial begin

         $display("hello verilog");    //                   for(i=0;i<8;i=i+1)         begin          $display("%d:%h",i,test[i]);   //         end         end