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FPGA設計之硬體篇(一)

     完成整個硬體電路板的設計後,接下來就是程式的設計了,這裡面靈活性很大,在設計中一定要注意語法的嚴謹性,一個小小的“<="都會帶來無盡的麻煩,在完成程式設計後,一定要進行時序模擬,我一般是先把模組分塊利用工具內部波形模擬來檢視時序,接著採用SIGNAL TAP II進行內部邏輯分析,這個花了太多時間了,一個模擬就要幾個小時。所以還是用TESTBENCH比較實際,注意是測試訊號建立時間保持時間是否滿足時序要求。