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FPGA計算器實現心得

       書一共有10章,按作者的意思是一天一章,第一章是數碼管的顯示設計,由於我學過微控制器程式設計,經常出錯的也就是語法方面。這第一次程式設計說簡單其實也很簡單,不過Verilog的程式設計真的很不一樣,雖然正式學之前聽說過Verilog屬於硬體描述語言,屬於模組和併發性,然而學到輸入狀態機那一章是出現了一個問題,也應該是硬體程式設計經常遇到的一個問題,那就是出現的bug不一定是錯誤提示的地方,而是其他模組裡面,這就很無奈了。(覺得這是新手經常遇到的問題,熟悉後不知道會不會也是這樣,畢竟我這是語法問題)