Verilog實現單週期CPU(部分MIPS指令集的指令)
這學期比較忙，很久沒發部落格了，先附上原始碼，等過完期末再補全博文
原始碼連結：https://github.com/AlexZhang267/Single-Cycle-CPU
注：我是在編輯器中寫的，用Icarus Verilog編譯執行的，沒用vivado。
單週期，沒有pipeline，太簡單了。。。不想寫說明了，就是對著這張圖寫的。
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這學期比較忙，很久沒發部落格了，先附上原始碼，等過完期末再補全博文 原始碼連結：https://github.com/AlexZhang267/Single-Cycle-CPU 注：我是在編輯器中寫的，用Icarus Verilog編譯執行的，沒用vivad
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